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1、包交换路及包交换方法
[简介] 本技术提供一种包交换路及包交换方法。每个输入端口均具有输入缓存，每个输出端口均具有输出缓存；第一轮元，用于对输入端口的输入缓存进轮；路由计算元，用于对轮到的输入缓存存储的至少一个数据包进路由

2、包交换路及包交换方法
[简介] 本技术涉及一种移缓存器路的布局结构，包括第一移缓存器以及与第一移缓存器相邻设置的第二移缓存器。其，第一移缓存器与第二移缓存器皆接收第一信与第二信，第二信与第一信互为反相。再者，第一移

3、移缓存器路的布局结构
[简介] 一种数据高速传输路，包括一控制元、一数据处理元和一数据存储元，所述数据处理元包括一断模块和一主处理芯片，所述断模块连接到所述控制元，并可接收所述控制元发出的一断信，所述数据处理元还包括

4、数据高速传输路和方法
[简介] 本技术提供一种重置缓存器方法以及重置缓存器路。重置缓存器方法包含以下步骤开启一计算。其，计算包含至少一缓存器。供至至少一缓存器。判断计算是否开成功。在判定计算开失败时，将至少一缓存器持续接地

5、重置缓存器方法以及重置缓存器路
[简介] 本技术提供一种像素路及其驱动方法、显示器件及显示方法，可消除第一条栅线至最后一条栅线之间的显示时间差，从而达到第一条栅线至最后一条栅线同时显示一个完整的一帧画面。该像素路的每个像素元包括数据线、充栅

6、一种像素路及其驱动方法、显示器件及显示方法
[简介] 本技术开了一种显示装置及其移缓存路，该移缓存路包含多级移缓存元，其每一级移缓存元具有上拉元用以输出第一驱动压；驱动元输出第一扫描信；压调整元，具有性耦接于压源的输入端以及

7、显示装置及其移缓存路
[简介] 一种移缓存器路包含多个级移缓存器以提供多个栅极信，所述级移缓存器的第N级移缓存器包含输入元、上拉元及下拉元。输入元用来根据第N-1级移缓存器产生的第N-1栅极信与第N-2级移缓存器产

8、移缓存器路
[简介] 本实用新型开了一种高速输入输出接口及其接收路。高速输入输出接口的接收路包括数据接收缓存、接收数据采样路、时钟接收缓存、时钟恢复路、第一相积分器。所述时钟恢复路包括锁相环、第二相积分器和时钟采样

9、高速输入输出接口及其接收路
[简介] 本技术开了一种高速输入输出接口的接收路，其包括数据接收缓存、接收数据采样路、时钟接收缓存、时钟恢复路、第一相积分器。所述时钟恢复路包括锁相环、第二相积分器和时钟采样路，所述锁相环产生本地参考时钟

10、高速输入输出接口及其接收路
[简介] 一种数字视频处理技术领域的全搜索扩展可变块运动估计路，包括四个缓存阵列、一个PE阵列，第一缓存阵列的输出端口与PE阵列的第一数据输入端相连接并传输搜索区域数据信息，第二缓存阵列的输出端口与PE阵列的第二数据输

11、全搜索扩展可变块运动估计路
[简介] 本技术开了一种应用SFEC的光传送网总线宽变换实现方法及路，该方法包括以下步骤S10、将从64系统总线输入的OTN帧的数据按外RS1023，1007编规则编后存入缓存M，缓存M由8块RAM构成，每块RAM的大小分别为15

12、应用SFEC的光传送网总线宽变换实现方法及路
[简介] 本技术开了一种近晶态液晶子纸显示器的有源像素路，其对对MxN点阵的液晶，使用i表示、使用j表示列，第ij像素的路包括晶体管Tij、缓存容Cij固态升压变压器PTij和像素CPij；输入信包括栅控制压VGi、源端

13、近晶态液晶多稳态子纸显示器的像素路
[简介] 本技术实施例提供一种移缓存器路，该移缓存器路包含多级移缓存器以提供多个栅极信至多个栅极线。每一级移缓存器包含上拉元、输入元、储能元、放元以及下拉元。上拉元根据驱动控制压与第一时钟

14、移缓存器路
[简介] 具有同步性能的双路信高速采集缓存路，涉及一种双路信采集缓存路。它是为了解决现有的高速数据采集系统由于片处理数据速度低导致采集系统的数据处理速度较低，以及双路信高速采集的严格同步性较低的问题

15、具有同步性能的双路信高速采集缓存路
[简介] 本技术开一种移缓存器路，该移缓存器路包含多级移缓存器以提供多个栅极信至多条栅极线。每一级移缓存器包含上拉元、用来接收输入信的输入元、用来根据输入信提供驱动控制压的储能元、放元

16、移缓存器路
[简介] 一种数字路系统，其包含有第一缓存元，用来接收并暂存数字数据；运算元，用来依据该第一缓存元所暂存的该数字数据，运算并产生结果数据；第二缓存元，用来接收并暂存该结果数据；多相时钟信产生元，用来产生复

17、时钟信产生路及具有此路的数字路
[简介] 本技术开了一种移缓存器路，所述移缓存器路包含多级移缓存器以提供多个栅极信，每一级移缓存器包含上拉元、进元、进控制元、输入元与下拉元。上拉元用来根据驱动控制压及第一频率以上拉栅

18、具双向传输制的移缓存器路
[简介] 本技术开了一种重置路，适用于调整移缓存器的输出端的，其包括重置路驱动模块以及重置模块。其，重置路驱动模块接收致能信以藉此在重置路驱动模块的输出端输出控制；重置模块性耦接至移缓存器

19、重置路
[简介] 本技术实施例开了一种鉴相器实现路和鉴相器时钟产生方法，涉及通信技术领域，通过较简的处理过程生成与业务时钟相适合的鉴相器时钟。所述鉴相器时钟产生方法包括速率比较器将业务数据写入缓存的速率和鉴相器从缓存

20、鉴相器实现路和鉴相器时钟产生方法
[简介] 本技术开了一种由闪存-SRAM流水线组成的存储路系统。该系统以流水线作方式，先向闪存写入数据，待其进入编程状态后，再往SRAM内写入数据，直至闪存编程结束。不断重复此过程，直到SRAM内存满数据。最后将SRAM的数据转

21、重置路
22、重置路
23、压识别处理器、压产生路和产生方法
24、开关装置与应用该开关装置的移缓存器路
25、一种应用于业监控设备的图像冗余缓存路
26、一种适用于HEVC标准的扩展可变块运动估计路
27、一种高可靠性的跨时钟域数据传输路
28、一种全数字时钟产生路及全数字时钟产生方法
29、具有多个处理器、缓存路和存储器的数据处理系统
30、路系统的抖动缓存调整方法
31、波形学习路对线解的方法
32、一种具有四种作模式的FIFO缓存路
33、一种数据缓存方法、垂直缩放路及终端
34、务器磁盘冗余阵列高速读写控制路结构
35、适应不同液晶屏的伽玛缓存路及具有该路的视
36、用于在源和目标处理路间转移作量的数据处理装置和方法
37、一种基于10GEPONONU的FEC硬件编方法及路
38、一种实现ATM多信元封装路的方法及网络处理器
39、视讯影像差异比对路
40、超声波融冰传感器数据采集路
41、数据处理路及应用其的处理器
42、数据处理路及应用其的处理器
43、栅极驱动路及其栅极驱动方法
44、具有允许写入未预先加载的高速缓存的高速缓存路的多处理路
45、高读取速度低切换噪声的存储器路及其方法
46、数据读取路
47、一种四象限乘法路
48、一种CMMB解调器时域同步路结构
49、移寄存路
50、半导体集成路器件
51、半导体集成路器件
52、光离子化检测器偏置压产生路
53、一种用于业CT探测器的采集路装置及方法
54、用以加载输出先进先出缓存器的宽时间窗口频率方法、路及内存
55、具有检错纠错路的非挥发存储器及其读写方法
56、具有检错纠错路的非挥发存储器及其读写数据的方法
57、可控的看门狗路
58、CCD信处理路高速数据流仲裁控制方法
59、显示面板的栅极驱动路
60、缓存控制装置、共亨缓存控制方法及集成路
61、路业务在基于以太网的无源光网络上传输的方法
62、路业务在基于以太网的无源光网络上传输的方法
63、用于数据处理装置的附加指令缓存路
64、一种终端设备基带处理系统的匹配滤波路装置及方法
65、基于乘累加器环的可配置离散小波变换路及其实现方法
66、一种基于捷联惯导系统的双AD信采集处理路
67、10GEPON报文的捕获路及写控制方法
68、一种数据缓存路
69、一种负载均衡路式分组交换结构及其构建方法
70、光谱仪控制路以及光谱仪
71、可复用加密键盘路及其设计方法
72、PCIExpress的TLP处理路及具备该处理路的继设备
73、信息显示装置、显示控制用集成路及显示控制方法
74、多核DSP可重构专用集成路系统
75、一种SDH指针处理方法及其路
76、液晶面板驱动路及液晶显示装置
77、硅基液晶显示器件的场缓存像素路
78、一种二维矩阵匹配方法及路
79、按键状态侦测路
80、按键状态侦测路
81、基于2M数据路传输质量实时在线监测的方法与装置
82、基于2M数据路传输质量实时在线监测的方法与装置
83、液晶显示面板及其栅极驱动路
84、液晶面板上的栅驱动路
85、适用于以差分输入路方式实现硬连线译器的技术
86、容式触控板的检测路及方法
87、移缓存器的时钟信供应方法与路
88、嵌入式系统的快闪存储器存取方法及存取路
89、一种及其用线接口路减小干扰的方法
90、数据解扰路
91、多重接口视频处理路
92、填充丢弃路和方法
93、高可靠度栅极驱动路
94、复用数据流路结构
95、同步数字信复用分解路
96、一种实现编的路和方法
97、一种芯片路的模拟测试方法和装置
98、一种硅基液晶显示器件的场缓存像素路
99、一种高阶滤波器路
100、匹配出现在两个或多个图像内的对象或人的方法、路和系统
101、一种多通道数据缓存区的NANDflash控制器路
102、一种多通道数据缓存区的NANDflash控制器路
103、RISC微处理器指令译路
104、逐出高速缓存的的路布置、数据处理系统和方法
105、高灵敏度读出路
106、显示接口路
107、可携式数据载体之微处理器路
108、业以太网实时数据传输和交换路
109、一种减少前导检测系统内存用量的路及方法
110、移寄存路
111、平面显示器的驱动路、方法及其显示面板
112、一种路掉保护装置及保护方法
113、用于可拆卸装置的具有高速缓存和接口的数据处理路
114、完全缓存OLED显示屏列控制路
115、一种TFT-LCD驱动路及液晶显示装置
116、音、视频数字信混合传输路
117、显示器驱动路、液晶显示器及显示器驱动方法
118、一种创造力训练的控制路
119、移缓存器、栅极驱动路及具有倍帧频率的液晶显示器
120、LED点阵扫描驱动控制路及LED点阵扫描控制芯片
121、解路、解装置及解系统
122、解路、解装置及解系统
123、解路、解装置及解系统
124、多载波干扰消除路及使用其的信收发系统
125、移缓存器的时脉除能路以及稳压结构
126、智能型液晶屏显示控制驱动路板
127、提高热光通信器件响应速度的测试方法及驱动路
128、采用高速缓存一致性负荷测试控制的路和方法
129、一种检测数字专用集成路触发器粒子效应的系统
130、全彩LED显示屏音视频图像处理及实时监控和传输路
131、采用数据线驱动路和数据线驱动方法的显示设备
132、发光二极管驱动路及串联式发光二极管发光系统
133、压监测路
134、接口装置、计算处理装置、接口生成装置以及路生成装置
135、移寄存路
136、移寄存路
137、高可靠度的移缓存器路
138、发光二极管驱动路及串联式发光二极管发光系统
139、平版显示路基于比特的运动补偿方法
140、具有高速缓存路的处理路检测高速缓存更新的游程
141、采用FPGA控制FED图像数据的传输与显示路
142、采用FPGA控制FED图像数据的传输与显示路
143、数据恢复方法及路
144、航天光学遥感器成像路的测试方法
145、一种移缓存器及栅极驱动路
146、绝对差和路
147、路结构
148、移暂存系统及液晶显示器驱动路
149、相加比较选择路及使用该路的维特比解器
150、具有输出致能控制路的栅极驱动器
151、移暂存系统、方法及液晶显示器驱动路
152、数据传输路及相关方法
153、显示器的源极驱动集成路架构
154、高可靠度栅极驱动路
155、基于可编程逻辑器件的硬件插补路
156、共用压调节路及液晶显示面板
157、动态随存取内存命令的控制路及方法
158、由数字逻辑和存储器构成的视全接收路
159、视节目分级接收路
160、二代联网核查设备快速升级路
161、基于波形识别的地铁车牵引路故障诊断系统
162、基于波形识别的地铁车牵引路故障诊断系统
163、子出版物阅览装置、子出版物阅览方法、程序以及集成路
164、用于模拟路故障诊断和预测的FPGA装置
165、防漏检测控制路
166、重新配置高速缓存以支持多态性的元数据的方法以及路
167、资料载体之微处理器路及组织存取储存于内存资料之方法
168、用于降低以太网无源光网络物理层集成路系统功耗的方法
169、路结构及其显示装置
170、一种高效读取的串Flash缓冲器控制路
171、基于数字信处理器的AC-PDP存储和控制路
172、物理层路和接口路
173、一种适用于CMMB和DVB-H的时域同步路结构
174、用于模拟驱动容性负载、尤其是压执器的路和方法
175、路业务在基于以太网的无源光网络上传输的方法
176、接口转换路板及具有该路板的移动硬盘盒和移动硬盘
177、视的片数据线的多重复用路
178、液晶显示面板及其集成路与该集成路的检测方法
179、一种基于彩色等离子显示器亮度调节的自动温升控制路
180、多任务喷印系统路及其控制路
181、显示设备驱动路
182、显示设备驱动路
183、一种虚路共用缓冲区描述链的方法
184、解装置和集成路
185、能量检测方法及应用其的能量检测路
186、基于FPGA实现的高速接口与低速接口转换路及方法
187、开关源路及子设备
188、回旋交错及去交错的路与方法
189、栅极驱动器、液晶显示器的驱动路以及液晶显示器
190、10G网络性能测试仪流量生成与发送路组件
191、基于匹配滤波的相关运算路
192、全数字存储数据的存储器直接存取方法及其接口路
193、高速网络分流设备用线路接口的包预处理路组件
194、扫描型显示装置控制路
195、具交织读出和编程能力的改进集成路存储器及作方法
196、数字基带芯片I2C模块的自动测试路结构及其方法
197、一种LED光学信采集路
198、一种用于逻辑路变更点搜寻方法及装置
199、提供可变数据输入输出宽度的路与方法
200、液晶显示器的驱动路和驱动方法
201、液晶显示器的色彩修正路及其方法
202、液晶显示器的色彩修正路及其方法
203、处理器路及读取数据的方法
204、可保护只读存储器数据的密保护路
205、用于可配置通信集成路和或芯片集的方法和系统
206、显示控制路及使用该显示控制路的显示系统
207、具有数据记录和检索路的微波激发紫外灯系统及其方法
208、基于IOS系统移动终端的加解密路
209、时钟产生路及产生方法
210、半导体集成路器件及其测试方法
211、实时波形平滑滚动及与背景图象叠加显示的方法和路
212、一种振荡器和使用这种振荡器的PLL路
213、一种飞显示模块的显示路
214、一种载显示模块的显示路
215、一种8051片系统升级方法及监控路
216、译路及编路
217、嵌入式零树编方法及其路结构
218、VGA接口路
219、一种超大规模集成路版图数据的管理方法
220、具有冲突解决方法的数据流分配的路结构
221、一种异步传输模式的信元复用路及方法
222、一种异步传输模式的信元复用路及方法
223、移动窗求和路
224、脉冲信转变延迟调节路
225、一种拼接式大面积场致发射背光源的动态调光路
226、优化存储控制器高速缓存卸载路性能和可靠性的系统
227、场致发射显示器（FED）视频驱动路
228、场致发射显示器（FED）视频驱动路
229、一种缩短循环纠错译算法的集成路实现方法及路
230、一种高速缓存动态划分方法与路
231、一种星载WCDMA接收参数化的FHT实现路
232、一种复值可控的数字路设计方法
233、大屏幕FED集成驱动路
234、显示装置用驱动路及可挠式印刷配线板及主动矩阵型显示装置
235、用于光时域反射仪的高速数据采集和实时累加处理路
236、移缓存元及相关的信驱动路与显示系统
237、一种实现解的路和方法
238、用于双线导体的驱动路和生成两个输出流的方法
239、集成路的总线接口路及输入输出缓冲路
240、含水层探测地震数据通信装置的以太网接口路
241、一种对振荡频率源进温度补偿和频率校正的路结构
242、一种对振荡频率源进温度补偿和频率校正的路结构
243、液晶显示驱动路及其使用的检验装置与容错方法
244、适用于高速缓存的读访问和存储路读分配
245、HAR技术数据缓存的设计方法及其路
246、显示器的数字图像缩放集成路
247、数字图像缩放集成路的设计方法
248、控制路以及控制方法
249、确定最小操作压的自测试路
250、一种实现可调节比例和精度的数字图像缩放路的方法
251、一种基于波形的语音压缩、解压缩方法及路
252、用于检测信息信水印的方法和路结构
253、八路数字视复用器专用集成路芯片
254、半导体存储器及其测试路、存储器系统、和数据传送系统
255、一种集成路装置
256、输出方法及相应的输出路
257、并视遥控器、遥控系统及遥控路
258、矩阵转置自动控制路系统及矩阵转置方法
259、同步多线程处理器路以及计算程序产品及运方法
260、应用于大屏幕的场致发射显示器的图像灰度调制方法及驱动路
261、用于缓冲数据流的方法和路
262、用于缓冲数据流的方法和路
263、一种分级放大路及多功能数据采集
264、一种分级放大路及多功能数据采集
265、可信设备集成路和对其的存储器件进虚拟化的方法
266、减少集成路泄漏流的方法和设备
267、基于DSP的液晶显示屏控制路
268、信息处理器和控制路
269、一种可显示彩色视频图像的场致发射显示器集成驱动路
270、数据接收路
271、一种可显示彩色视频图像的场致发射显示器集成驱动路
272、提供处理器磁芯和高速缓存压的容错调压器模块路
273、运动估计的超大规模集成路体系结构及数据缓存的方法
274、降低子路功耗的系统和方法
275、一种用于集成路设计的静止图像压缩率控制方法
276、纠错编译方法和利用这种方法的路
277、具有虚拟高速缓存的发声集成路
278、半导体集成路和数据处理系统
279、半导体集成路器件
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